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1、JK触发器在CP作用下,要使Qn+1=Qn,输入信号必为( )。

A、
B、
C、
D、

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2、对于边沿触发的D触发器,下面( )是正确的。

A、输出状态的改变发生在时钟脉冲的边沿
B、要输出的状态取决于D输入
C、输出跟随每一个时钟脉冲的输入
D、输出的状态不取决于D输入

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3、用n只触发器组成计数器,其最大计数模为 。

A、
B、
C、
D、

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4、电路如图所示,假设电路中各触发器的当前状态Q2 Q1 Q0为100,请问在时钟作用下,触发器下一状态Q2 Q1 Q0为 。

A、011
B、000
C、100
D、101

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5、在下列逻辑电路中,不是组合逻辑电路的有( )。

A、寄存器
B、全加器
C、编码器
D、译码器

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6、十进制计数器最高位输出的周期是输入CP脉冲周期的10倍。

A、错
B、对

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7、74LS161状态如图所示,下一个脉冲过后,Q3Q2Q1Q0=( )。

A、1000
B、1001
C、1011
D、1010

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8、用74LS90构成十进制计数器,有( )种连接方式。

A、2
B、1
C、3
D、4

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9、下图要完成10进制计数器,数据端数据D3D2D1D0=( )。

A、1010
B、1001
C、1000
D、1011

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10、电路如图所示。该电路实现( )进制计数器。

A、4
B、7
C、6
D、5

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